在不开启dol时,sharppen设置是有效的;
开启dol后,图像的锐度有些夸张,sharppen参数调节没有效果;
是否可以控制开启dol后的图像锐度?
H
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veye-mipi 327的wdr和sharppen无法同时起效
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RE: cs132和FPGA间的MIPI适配问题
@veye_xumm disable模组的MIPI-CSI2输出,是指配置streammode=1?初始化的第一条命令就是配置0x0e=1,reboot等待10s、20s都没有变化;调用reboot前,我关闭CSI/DPHY;初始化后,依次开启DPHY/CSI,DPHY的寄存器仍然上报clocklane进入退出状态;我想知道,sc132复位后的MIPI的工作状态的变化过程;
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cs132和FPGA间的MIPI适配问题
sc132通过mipi连接到黑金开发板的FPGA( Xilinx ZU2CG)上,PL端用MIPI CSI的IP核;
遇到的问题是:上电后,如果不向sc132发送reboot(0x0187)或是reset(0x0104),ip核(包括dphy和csi)内部的寄存器读数相对正常,不影响出图;
如果向sc132发送reboot或是reset,等待5秒后,dphy寄存器上报clocklane进入退出状态,反复复位dphy不起作用;请问如何解决